JP-2026077850-A - 符号化装置、復号装置、符号化方法、復号方法及び送信方法

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Abstract

【課題】効率的にタイル及びサブピクチャを特定することができる符号化装置を提供する。【解決手段】符号化装置（１００）は、回路と、回路に接続されたメモリとを備え、回路は、動作において、ピクチャを構成する１つ以上のタイルのうちの１つのタイルが、ピクチャを構成する１つ以上のサブピクチャを欠損なく包含する制約条件に従って、１つ以上のタイルおよび１つ以上のサブピクチャを決定し、１つ以上のサブピクチャの位置、幅、及び高さを示す情報が格納されたビットストリームを生成する。【選択図】図１１３

Inventors

安倍清史
西孝啓
遠間正真
加藤祐介

Assignees

パナソニックインテレクチュアルプロパティコーポレーションオブアメリカ

Dates

Publication Date: 20260513
Application Date: 20260219
Priority Date: 20190927

Claims (7)

回路と、前記回路に接続されたメモリとを備え、前記回路は、動作において、ピクチャを構成する１つ以上のタイルのうちの１つのタイルが、前記ピクチャを構成する１つ以上のサブピクチャを欠損なく包含する制約条件に従って、前記１つ以上のタイルおよび前記１つ以上のサブピクチャを決定し、前記１つ以上のサブピクチャの位置、幅、及び高さを示す情報が格納されたビットストリームを生成する、符号化装置。
前記回路は、前記制約条件に加えて、（ｉ）前記１つ以上のサブピクチャのそれぞれについて、当該サブピクチャが、前記ピクチャを構成する１つ以上のスライスのうちの１つ以上のスライスを欠損なく包含する第１制約条件と、（ｉｉ）前記１つ以上のサブピクチャのそれぞれについて、当該サブピクチャが、前記１つ以上のタイルのうちの１つ以上のタイルを欠損なく包含している第２制約条件と、に従って、前記１つ以上のタイル、前記１つ以上のサブピクチャ、および、前記１つ以上のスライスを決定する、請求項１に記載の符号化装置。
回路と、前記回路に接続されたメモリとを備え、前記回路は、動作において、ピクチャを構成する１つ以上のサブピクチャの位置、幅、及び高さを示す情報が格納されたビットストリームを取得し、前記ピクチャを構成する１つ以上のタイルのうちの１つのタイルが、前記１つ以上のサブピクチャを欠損なく包含する制約条件に従って、前記１つ以上のタイルおよび前記１つ以上のサブピクチャを決定する、復号装置。
前記回路は、前記制約条件に加えて、（ｉ）前記１つ以上のサブピクチャのそれぞれについて、当該サブピクチャが、前記ピクチャを構成する１つ以上のスライスのうちの１つ以上のスライスを欠損なく包含する第１制約条件と、（ｉｉ）前記１つ以上のサブピクチャのそれぞれについて、当該サブピクチャが、前記１つ以上のタイルのうちの１つ以上のタイルを欠損なく包含している第２制約条件と、に従って、前記１つ以上のタイル、前記１つ以上のサブピクチャ、および、前記１つ以上のスライスを決定する、請求項３に記載の復号装置。
ピクチャを構成する１つ以上のタイルのうちの１つのタイルが、前記ピクチャを構成する１つ以上のサブピクチャを欠損なく包含する制約条件に従って、前記１つ以上のタイルおよび前記１つ以上のサブピクチャを決定し、前記１つ以上のサブピクチャの位置、幅、及び高さを示す情報を格納したビットストリームを生成する、符号化方法。
ピクチャを構成する１つ以上のサブピクチャの位置、幅、及び高さを示す情報が格納されたビットストリームを取得し、前記ピクチャを構成する１つ以上のタイルのうちの１つのタイルが、前記１つ以上のサブピクチャを欠損なく包含する制約条件に従って、前記１つ以上のタイルおよび前記１つ以上のサブピクチャを決定する、復号方法。
ピクチャを構成する１つ以上のタイルのうちの１つのタイルが、前記ピクチャを構成する１つ以上のサブピクチャを欠損なく包含する制約条件に従って、前記１つ以上のタイルおよび前記１つ以上のサブピクチャを決定し、前記１つ以上のサブピクチャの位置、幅、及び高さを示す情報を格納したビットストリームを生成し、前記ビットストリームを送信する、送信方法。

Description

本開示は、符号化装置等に関する。ビデオコーディング技術は、Ｈ．２６１およびＭＰＥＧ－１から、Ｈ．２６４／ＡＶＣ（ＡｄｖａｎｃｅｄＶｉｄｅｏＣｏｄｉｎｇ）、ＭＰＥＧ－ＬＡ、Ｈ．２６５／ＨＥＶＣ（ＨｉｇｈＥｆｆｉｃｉｅｎｃｙＶｉｄｅｏＣｏｄｉｎｇ）、およびＨ．２６６／ＶＶＣ（ＶｅｒｓａｔｉｌｅＶｉｄｅｏＣｏｄｅｃ）へ進歩している。この進歩に伴い、様々な用途において増え続けるデジタルビデオデータ量を処理するために、ビデオコーディング技術の改良および最適化を提供することが常に必要とされている。本開示は、ビデオコーディングにおけるさらなる進歩、改良および最適化に関する。なお、非特許文献１は、上述されたビデオコーディング技術に関する従来の規格の一例に関する。Ｈ．２６５（ＩＳＯ／ＩＥＣ２３００８－２ＨＥＶＣ）／ＨＥＶＣ（ＨｉｇｈＥｆｆｉｃｉｅｎｃｙＶｉｄｅｏＣｏｄｉｎｇ）図１は、実施の形態に係る伝送システムの構成の一例を示す概略図である。図２は、ストリームにおけるデータの階層構造の一例を示す図である。図３は、スライスの構成の一例を示す図である。図４は、タイルの構成の一例を示す図である。図５は、スケーラブル符号化時の符号化構造の一例を示す図である。図６は、スケーラブル符号化時の符号化構造の一例を示す図である。図７は、実施の形態に係る符号化装置の機能構成の一例を示すブロック図である。図８は、符号化装置の実装例を示すブロック図である。図９は、符号化装置による全体的な符号化処理の一例を示すフローチャートである。図１０は、ブロック分割の一例を示す図である。図１１は、分割部の機能構成の一例を示す図である。図１２は、分割パターンの例を示す図である。図１３Ａは、分割パターンのシンタックスツリーの一例を示す図である。図１３Ｂは、分割パターンのシンタックスツリーの他の例を示す図である。図１４は、各変換タイプに対応する変換基底関数を示す表である。図１５は、ＳＶＴの一例を示す図である。図１６は、変換部による処理の一例を示すフローチャートである。図１７は、変換部による処理の他の例を示すフローチャートである。図１８は、量子化部の機能構成の一例を示すブロック図である。図１９は、量子化部による量子化の一例を示すフローチャートである。図２０は、エントロピー符号化部の機能構成の一例を示すブロック図である。図２１は、エントロピー符号化部におけるＣＡＢＡＣの流れを示す図である。図２２は、ループフィルタ部の機能構成の一例を示すブロック図である。図２３Ａは、ＡＬＦ（ａｄａｐｔｉｖｅｌｏｏｐｆｉｌｔｅｒ）で用いられるフィルタの形状の一例を示す図である。図２３Ｂは、ＡＬＦで用いられるフィルタの形状の他の一例を示す図である。図２３Ｃは、ＡＬＦで用いられるフィルタの形状の他の一例を示す図である。図２３Ｄは、Ｙサンプル（第１成分）がＣｂのＣＣＡＬＦおよびＣｒのＣＣＡＬＦ（第１成分とは異なる複数の成分）に使用される例を示す図である。図２３Ｅは、ダイヤモンド形状フィルタを示す図である。図２３Ｆは、ＪＣ－ＣＣＡＬＦの例を示す図である。図２３Ｇは、ＪＣ－ＣＣＡＬＦのｗｅｉｇｈｔ＿ｉｎｄｅｘ候補の例を示す図である。図２４は、ＤＢＦとして機能するループフィルタ部の詳細な構成の一例を示すブロック図である。図２５は、ブロック境界に対して対称なフィルタ特性を有するデブロッキング・フィルタの例を示す図である。図２６は、デブロッキング・フィルタ処理が行われるブロック境界の一例を説明するための図である。図２７は、Ｂｓ値の一例を示す図である。図２８は、符号化装置の予測部で行われる処理の一例を示すフローチャートである。図２９は、符号化装置の予測部で行われる処理の他の例を示すフローチャートである。図３０は、符号化装置の予測部で行われる処理の他の例を示すフローチャートである。図３１は、イントラ予測における６７個のイントラ予測モードの一例を示す図である。図３２は、イントラ予測部による処理の一例を示すフローチャートである。図３３は、各参照ピクチャの一例を示す図である。図３４は、参照ピクチャリストの一例を示す概念図である。図３５は、インター予測の基本的な処理の流れを示すフローチャートである。図３６は、ＭＶ導出の一例を示すフローチャートである。図３７は、ＭＶ導出の他の例を示すフローチャートである。図３８Ａは、ＭＶ導出の各モードの分類の一例を示す図である。図３８Ｂは、ＭＶ導出の各モードの分類の一例を示す図である。図３９は、ノーマルインターモードによるインター予測の例を示すフローチャートである。図４０は、ノーマルマージモードによるインター予測の例を示すフローチャートである。図４１は、ノーマルマージモードによるＭＶ導出処理の一例を説明するための図である。図４２は、ＨＭＶＰモードによるＭＶ導出処理の一例を説明するための図である。図４３は、ＦＲＵＣ（ｆｒａｍｅｒａｔｅｕｐｃｏｎｖｅｒｓｉｏｎ）の一例を示すフローチャートである。図４４は、動き軌道に沿う２つのブロック間でのパターンマッチング（バイラテラルマッチング）の一例を説明するための図である。図４５は、カレントピクチャ内のテンプレートと参照ピクチャ内のブロックとの間でのパターンマッチング（テンプレートマッチング）の一例を説明するための図である。図４６Ａは、２つの制御ポイントを用いるアフィンモードにおけるサブブロック単位のＭＶの導出の一例を説明するための図である。図４６Ｂは、３つの制御ポイントを用いるアフィンモードにおけるサブブロック単位のＭＶの導出の一例を説明するための図である。図４７Ａは、アフィンモードにおける制御ポイントのＭＶ導出の一例を説明するための概念図である。図４７Ｂは、アフィンモードにおける制御ポイントのＭＶ導出の一例を説明するための概念図である。図４７Ｃは、アフィンモードにおける制御ポイントのＭＶ導出の一例を説明するための概念図である。図４８Ａは、２つの制御ポイントを有するアフィンモードを説明するための図である。図４８Ｂは、３つの制御ポイントを有するアフィンモードを説明するための図である。図４９Ａは、符号化済みブロックとカレントブロックで制御ポイントの数が異なる場合の、制御ポイントのＭＶ導出方法の一例を説明するための概念図である。図４９Ｂは、符号化済みブロックとカレントブロックで制御ポイントの数が異なる場合の、制御ポイントのＭＶ導出方法の他の例を説明するための概念図である。図５０は、アフィンマージモードの処理の一例を示すフローチャートである。図５１は、アフィンインターモードの処理の一例を示すフローチャートである。図５２Ａは、２つの三角形の予測画像の生成を説明するための図である。図５２Ｂは、第１パーティションの第１部分、並びに、第１サンプルセット及び第２サンプルセットの例を示す概念図である。図５２Ｃは、第１パーティションの第１部分を示す概念図である。図５３は、トライアングルモードの一例を示すフローチャートである。図５４は、サブブロック単位にＭＶが導出されるＡＴＭＶＰモードの一例を示す図である。図５５は、マージモードおよびＤＭＶＲ（ｄｙｎａｍｉｃｍｏｔｉｏｎｖｅｃｔｏｒｒｅｆｒｅｓｈｉｎｇ）の関係を示す図である。図５６は、ＤＭＶＲの一例を説明するための概念図である。図５７は、ＭＶを決定するためのＤＭＶＲの他の一例を説明するための概念図である。図５８Ａは、ＤＭＶＲにおける動き探索の一例を示す図である。図５８Ｂは、ＤＭＶＲにおける動き探索の一例を示すフローチャートである。図５９は、予測画像の生成の一例を示すフローチャートである。図６０は、予測画像の生成の他の例を示すフローチャートである。図６１は、ＯＢＭＣ（ｏｖｅｒｌａｐｐｅｄｂｌｏｃｋｍｏｔｉｏｎｃｏｍｐｅｎｓａｔｉｏｎ）による予測画像補正処理の一例を説明するためのフローチャートである。図６２は、ＯＢＭＣによる予測画像補正処理の一例を説明するための概念図である。図６３は、等速直線運動を仮定したモデルを説明するための図である。図６４は、ＢＩＯにしたがったインター予測の一例を示すフローチャートである。図６５は、ＢＩＯにしたがったインター予測を行うインター予測部の機能構成の一例を示す図である。図６６Ａは、ＬＩＣ（ｌｏｃａｌｉｌｌｕｍｉｎａｔｉｏｎｃｏｍｐｅｎｓａｔｉｏｎ）による輝度補正処理を用いた予測画像生成方法の一例を説明するための図である。図６６Ｂは、ＬＩＣによる輝度補正処理を用いた予測画像生成方法の一例を示すフローチャートである。図６７は、実施の形態に係る復号装置の機能構成を示すブロック図である。図６８は、復号装置の実装例を示すブロック図である。図６９は、復号装置による全体的な復号処理の一例を示すフローチャートである。図７０は、分割決定部と他の構成要素との関係を示す図である。図７１は、エントロピー復号部の機能構成の一例を示すブロック図である。図７２は、エントロピー復号部におけるＣＡＢＡＣの流れを示す図である。図７３は、逆量子化部の機能構成の一例を示すブロック図である。図７４は、逆量子化部による逆量子化の一例を示すフローチャートである。図７５は、逆変換部による処理の一例を示すフローチャートである。図７６は、逆変換部による処理の他の例を示すフローチャートである。図７７は、ループフィルタ部の機能構成の一例を示すブロック図である。図７８は、復号装置の予測部で行われる処理の一例を示すフローチャートである。図７９は、復号装置の予測部で行われる処理の他の例を示すフローチャートである。図８０Ａは、復号装置の予測部で行われる処理の他の例の一部を示すフローチャートである。図８０Ｂは、復号装置の予測部で行われる処理の他の例の残部を示すフローチャートである。図８１は、復号装置のイントラ予測部による処理の一例を示す図である。図８２は、復号装置におけるＭＶ導出の一例を示すフローチャートである。図８３は、復号装置におけるＭＶ導出の他の例を示すフローチャートである。図８４は、復号装置におけるノーマルインターモードによるインター予測の例を示すフローチャートである。図８５は、復号装置におけるノーマルマージモードによるインター予測の例を示すフローチャートである。図８６は、復号装置におけるＦＲＵＣモードによるインター予測の例を示すフローチャートである。図８７は、復号装置におけるアフィンマージモードによるインター予測の例を示すフローチャートである。図８８は、復号装置におけるアフィンインターモードによるインター予測の例を示すフローチャートである。図８９は、復号装置におけるトライアングルモードによるインター予測の例を示すフローチャートである。図９０は、復号装置におけるＤＭＶＲによる動き探索の例を示すフローチャートである。図９１は、復号装置におけるＤＭＶＲによる動き探索の詳細な一例を示すフローチャートである。図９２は、復号装置における予測画像の生成の一例を示すフローチャートである。図９３は、復号装置における予測画像の生成の他の例を示すフローチャートである。図９４は、復号装置におけるＯＢＭＣによる予測画像の補正の例を示すフローチャートである。図９５は、復号装置におけるＢＩＯによる予測画像の補正の例を示すフローチャートである。図９６は、復号装置におけるＬＩＣによる予測画像の補正の例を示すフローチャートである。図９７は、サブピクチャとスライスとタイルとの関係を示す概念図である。図９８は、タイルとスライスとの関係を示す概念図である。図９９は、第１態様に係るサブピクチャに関するシンタックス構造図である。図１００Ａは、ピクチャにおける各領域のタイルインデックスを示す概念図である。図１００Ｂは、ピクチャにおける各領域のサブピクチャインデックスを示す概念図である。図１０１は